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Diseño de sumador baja potencia para VLSI

Name: Diseño de sumador baja potencia para VLSI
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Bol Este trabajo propone un sumador aproximado energéticamente eficiente que proporciona una suma de alto rendimiento y bajo consumo sin degradación severa de la calidad. El sumador propuesto introduce una lógica aproximada de área eficiente que se utiliza para sumar los bits menos significativos del sumador. La eficacia del sumador se analiza sobre los conocidos sumadores precisos y aproximados mediante la implementación en Tanner y MATLAB. El resultado de la simulación muestra que el sumador propuesto supera al sumador existente y se puede aplicar eficazmente a las aplicaciones que pueden tolerar una pequeña cantidad de error.

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Este trabajo propone un sumador aproximado energéticamente eficiente que proporciona una suma de alto rendimiento y bajo consumo sin degradación severa de la calidad. El sumador propuesto introduce una lógica aproximada de área eficiente que se utiliza para sumar los bits menos significativos del sumador. La eficacia del sumador se analiza sobre los conocidos sumadores precisos y aproximados mediante la implementación en Tanner y MATLAB. El resultado de la simulación muestra que el sumador propuesto supera al sumador existente y se puede aplicar eficazmente a las aplicaciones que pueden tolerar una pequeña cantidad de error.

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